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深入了解EVT/DVT/PVT：新產品開發的三個關鍵驗證階段解說
新產品開發時，通常都會透過所謂的「試產(Trial run)」來取得原型樣機(Prototype) ，一方面是為了讓研發者可以拿樣機來作進一步的驗證測試，另一方面也可以讓製造工廠盡早瞭解這個新產品的製程，並即時準備量產事宜，各單位也可以就樣機的測試結果提出一些相關的建議。
一般來說，製造端必須提出一些 DFM (Design For Manufacturing)與製造生產相關的意見，免得設計者高高興興地把產品功能及外觀設計得非常完美，但製造工廠卻生產不出來的窘境，當然還有許多其他有關單位都會提出相關意見，比如說設計品管部門(DQ)會提出這項產品功能驗證測試的結果，市場維修也會反饋那些地方不利維修之類的問題。
建議延伸閱讀：為什麼新產品需要試產？可以從試產得到什麼？
在新產品開發的程序上一般會有三個試產的驗證(verification)階段，每個階段都可以再細分好幾次，比如說 EVT1, EVT2,…，或是直接跳過，原則上試產需要與否應視實際需求來決定，還有~不要為了試產而試產，試產一定要有目的或必須性，否則產品試產既浪費金錢也浪費時間，因為每次的試產都要有研發及製造相關的工程師在場支援(on-site support)，如果是自己的工廠還好，如果試產是在代工廠，那就真的很麻煩。
下面是新產品試產的三個階段EVT、DVT、PVT的相關說明與解釋，有些公司可能不是使用這個名詞，但精神上大同小異：
EVT : Engineering Verification Test (工程驗證測試階段)
一般在EVT階段所生產出來的樣機只有組裝電路板(PCBA)，而且是那種很大一片的板子，我們通常稱之為【Big Board】，研發工程師通常會先把他想要驗證的想法或是無法決定的設計擺在這種板子上面。所以這種設計通常是硬體電路的工程驗證(verification)、除錯(debug)之用而已，你可能很難想像這種電路板日後會成為輕巧的手機或是產品。
大體來說，如果所研發的產品屬於全新的平台，第一次剛設計出來時，問題一定很多，有時候甚至只會是實驗性質，研發工程師可能都還沒個底，到底要採取哪種可行的設計方案？所以有可能會有好幾次的EVT試產，得視研發狀況而定，重點是要有足夠的時間及樣品好讓研發工程師可以驗證其想法。有一點要提醒的，每次的樣品試產都是一筆不小的費用，能用一次EVT就解決的話就不要做第兩次EVT。
關於發想驗證的部份，有人提出POC(Proof Of Concept)的觀念，這個好像比較常用在軟體開發上，但是硬體開發也可以適用，對於全新產品希望可以在開始投入大量人力做研發前先把理論可行性給釐清，確認理論正確了，才讓大部隊跟著往前衝。
POC可以放在EVT之前或專案開發之前，有興趣的朋友可以參考這篇文章：新產品開發階段，什麼是POC？與EVT/DVT/PVT有何關係？
如果設計是屬於修改既有產品的設計，那就會比較簡單，因為不會有太多的新技術，也就不需要太多的EVT試產，有時候甚至會直接跳過EVT而進入下個階段。
EVT 的重點：所有可能的設計問題都必須被提出來一一修正， 所以重點在考慮設計的可行性，並檢查是否有任何規格被遺漏了。
DVT: Design Verification Test (設計驗證測試階段)
這是研發的第二階段，所有設計的發想應該都已經完成。這個時候會把機構的外殼加上來，另外印刷電路板(PCB)也要達到實際的尺寸大小，這樣才可以把電路板整個放到機構殼中。
這個階段的機構外殼可能一開始只拿一塊大的樹脂用雷射雕刻所製作出來的樣品(mockup)，或是用軟模具所生產出來的產品而已，技術進步後，現在應該有機會用3D列印機來成型，目的是希望在正式模具發包量產前，用來驗證機構外殼的設計是否符合需求，因為真正的模具費用很貴，所以要先驗證沒有問題了才能正式開模。
DVT階段要驗證整機的功能，重點是把設計及製造的問題找出來，以確保所有的設計都符合規格，而且可以量產。
PVT: Production Verification Test(生產驗證測試階段)
在進入PVT階段前，所有關於產品設計的驗證工作應該都要全部完成，也就是說，所有設計上的驗證都必須告一段落，原則上不可以再有設計上的大變更，當然後續市場或是量產後的設計變更不在此限。
這個階段試產的目的是要做製造工廠大量生產（Mass Production）前的製造流程測試，所以必須要生產一定數量的產品，所有的零件都應該要求供應商使用正式模具或是量產工具所生產出來，不可以再使用EVT或DVT的手工樣品，而且生產線上所有的生產程序也都要符合製造廠的標準量產程序，也就是必須要有整條生產線的流程，不能再是走走停停的生產。
另外，還要計算所有的治工具、測試治具及生產設備數量是否可以符合大量產後的產能(capacity)。
不過在新產品的開發過程中可不是只有「試產」喔！在整個新產品的開發週期裡其實包含了從提案、市調、研發、試賣、量產、持續改善、終產等好幾個階段，試產只是研發階段的細項，因為需要比較多人參與，所以才會比較受到重視。
相關閱讀：
簡介產品生命週期(PLC) I
簡介產品生命週期(PLC) II
後記：
另外，試產的名稱各家命名也各有不同，有人會用SR/ER/PR，有人用C0～C6，也有人用最簡單的A-Run/B-Run/C-Run…等，不過大體上觀念是一樣的，執行的步驟及方法也都雷同。
延伸閱讀：
測試工程師(Testing Engineer)在公司的角色
電子製造工廠如何產出一片組裝電路板(PCBA)
給初學者：BOM表與ECO、ECN、ECR的關係
新產品開發會議中的經常聽到CMF是什麼意思？
給初學者：SKU(死雞屋,Stock Keeping Unit)生產什麼
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訪客留言內容（Comments）
請教熊大PCB化金製程
1.化金製程厚度 : 金手指(鍍金接點)和3~5μm，化學鎳(Ni)120~150μ in(假設130μm) , 化學金PAD 1μ in.次厚度可行嗎
2.此參數在SMT生產,品質是否穩定.
3.另黑墊產生有可能是在那一個環節.
我司是Cable modem R&D,PCB表面處理 PAD 化金1u ,在SMT單面製程比較保險，但双面製程表面處理 PAD 化金2~3u,可避免Ni氧化，這樣說合理是嗎?
2. 或許可能問題在於Ni吧，Ni是讓浸金附著在表面，形成化金，但奇怪，金不是抗氧化嗎?
板廠不會說實話，只能從SMT去驗證它說,同事說太薄Ni就會浮出來了,Ni 100u以下才算薄嗎?
3. 白蓉生研究報告內指出:故鎳層會造成高頻訊號
（Signal）能量方面的損失（Signal Loss），不可不事先考慮。若必須鍍鎳
時其厚度也應低於2.5m m（100m in），以減少功能方面的異常，
(我司CB產品對訊號很敏感)
4.大陸板廠最近要求化金降至2u,成本考量，我不理會，堅持3u嗎?
5. 白蓉生研究報告內指出阻隔效應（Barrier Effect）
電鍍鎳或化學鎳，對金與銅之間的遷移（Migration）或擴散
（Diffusion）都具有阻絕效應，後者尤佳。當板子處於高溫環境中時，金與
銅的『相互往來』將會增快。以板邊金手指而言，其『接觸電阻』（Contact
Resistance）的品質對整體功能頗具舉足輕重的地位，一旦金層遭銅侵入，整
體功能自然受損。下表2即為各種鎳層厚度經1000小時高溫考驗後，其接觸電
阻值劣化的對照數據。
G/F中鎳厚度65℃中之接觸性125℃中之接觸性200℃中之接觸性
0.0mm 100% 40% 0%
0.5mm 100% 90% 5%
2.0mm 100% 100% 10%
4.0mm 100% 100% 60%
由表2之實驗數據可知，低溫環境中銅與金之間的遷移並不會造成『接觸
電阻』的障礙，甚至無鎳層的存在也不致發生太大的麻煩。常用的大哥大手機
與呼叫器等，其化鎳厚度只需80m in即已足夠達到阻隔效應。現實中一般規格
對鎳厚都要求在150m in以上，似嫌稍苛。(這個幫我解惑一下)
以上感謝…
熊大:
請教目前SMT設備品牌,在於SMT設備流線中軌道寬約5mm,PCB Layout也因此需設置板邊上下5mm禁置區,此範圍內不可有Layout PAD,據我所知設備有FUJI,SANYO,UNIVERSAL,Samsung,JUKI.
請問還有那些機器
Hi 熊大
陰陽板雙面製程問題請教:
Reflow双面製程,上下(TOP面 & BOT面)階有零件含R,C,L,SOT23,323,89晶體類,diode類,T0252,SOIC,BGA,以9區迴焊爐(熱風式循環)馬鞍型曲線設定,TOP面&BOT面零件R,C,L,SOT23,323,89晶體類,diode類,T0252,SOIC在熔錫區溫度有3~6度溫差,則BGA內部 TOP面&BOT面有8~12度的溫差,所以BGA双面製程是OK的,但QFN 56P~128P在BOT面,Reflow有可能掉落,我的印象是這樣.不知是否有誤差
Hi 熊大
上面的我都有衡量過,我是想問你們是否有做過PCB表面溫度量測,零件含R,C,L,SOT23,323,89晶體類,diode類,T0252,SOIC,TOP面 BOT面溫度差異,和BGA TOP面 BOT面溫度差異
Hi 熊大
請教
產品上有QFN50P~150P Layout,鋼板開法是否要注意,其中Ground 的開法錫量不可太多,零件容易浮高,造成pin腳open,若雙面製程都有QFN150P Layout,請問你們的作法是？
Hi 雄大
您好~想跟您請教，如果DVT階段因為試產數量大約100~200ea左右，都無發現問題，但是到PVT時數量約1000~2000ea開始發現設計上議題，但反饋給客戶，客戶認為DVT無反應過，認為是製程可改善問題，但對於工廠來說會增加額外成本及工時，這部分有無建議DVT→PVT階段該如何確認
錯字放了十幾年都沒有人看到?
但是硬體開法也可以試用，對於全新產品希望可以在開始投入大量人力做研發前先把理論給釐清，確認理論正確了，才讓大部對往前衝。
但是硬體開(發)也可以試用，對於全新產品希望可以在開始投入大量人力做研發前先把理論給釐清，確認理論正確了，才讓大部(隊)往前衝。
熊大您好：
這篇文章講解地非常清楚，受教了。謝謝您。
有一個小小的地方是文中最後一個圖中的beta impalement(試賣)那個地方，impalement和implement應該是兩個完全截然不同的概念才對。然後我想此處您想表達的一定是implement不會有錯，分享給您。
謝謝：)
Hi，
我在工作实践中确实发现，不同的公司可能模糊了EVT、DVT等内容的边界，看到你这个帖子的时间很早了，但还是想要问一下，很多公司非常想要拉长EVT的时间，在阶段准出时甚至于要求完成度达到→含白身外观；但又有部分公司只在EVT阶段仅完成主要功能块的稳定运行就准出了，其将主要模块的combo放在了DVT阶段；工作熊是否可以讲讲，即使截止到距离发文已经如此久之后，当下所遇见的大部分的分段形式？多谢~
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